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《通信技术》 2009年12期
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DVB系统中扰码发生器的FPGA实现

吕锋  徐宇白  
【摘要】:为了保证在任何情况下进入数字电视DVB传输系统的数据码流中"0"与"1"的概率都能基本相等,传输系统首先要用一个伪随机序列对输入的MPEG-2码流进行扰乱处理。给出了DVB标准中扰码发生器的FPGA设计方案,并以Altera公司的QuartusII为开发平台,运用Verilog语言描述了各部分设计并给出仿真结果。
【作者单位】武汉理工大学信息学院通信试验室;
【基金】:863计划(编号:2007AA12Z170)
【分类号】:TN949.197;TN791

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