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《电子技术》 2017年09期
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基于CPLD与VHDL语言的数字钟设计

王维斌  
【摘要】:文章介绍了一种利用CPLD进行数字钟设计的方法,设计中采用VHDL语言进行每个模块程序的设计,实现利用数码管进行时、分、秒的显示,利用按键进行时间的设置与调整,并且在CPLD实验板上进行了验证,实现了系统的设计。本设计采用模块化设计,具有设计简单,程序可读性强等特点。
【作者单位】湖南汽车工程职业学院;
【分类号】:TN79

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