| | | | | 基于FPGA的FIR数字滤波器算法实现 | | | 蒋垒;王昌林;刘鎏;许冲 | | | 从分析FIR数字滤波器的原理和设计方法入手,主要针对基于FPGA实现数字滤波器乘法器的算法进行了比较研究,并通过一个8阶FIR低通滤波器的具体设计,简要分析比较了几种算法的优越性和缺点,从而充分发掘和利用FP-GA的高速特性。
【作者单位】：解放军电子工程学院 合肥230037(蒋垒;王昌林;刘鎏);解放军68215部队 民和810800(许冲)
【关键词】：VHDL;FPGA;数字滤波器
【分类号】：TN713.7
【DOI】：cnki:ISSN:1672-9730.0.2006-01-040
【正文快照】：
1引言数字滤波器在数字信号处理中占有非常重要的地位,几乎是所有数字信号处理系统中通用的基本构建模块之一。用VHDL语言对FIR滤波器进行描述,方便在不同的实现方式下移植和修改滤波器参数,因而逐步成为数字滤波器设计主流。但是,数字滤波器的输出采样是通过将输入采样流与滤波系数卷积而得到,滤波系数定义了网络的频率响应。在要求高阶滤波、高采样率或两者兼有的应用中,所需算法工作量将会十分庞大。计算一个输出值需要N次乘法和N-1次加法。如何改进设计方法减少资源占用,对目前大多数信号处理设计者来讲都非常诱人。本文将就目前FI… | | |  推荐 CAJ下载  PDF下载 | | | CAJViewer7.0阅读器支持所有CNKI文件格式，AdobeReader仅支持PDF格式 | | | | Design of FIR Filter in FPGA | | | Jiang Lei~(1)) Wang Changlin~(1)) Liu Liu~(1)) Xu Chong~(2))(Hefei PLA Electric Engineering Institute~(1));Hefei 230037)(PLA of 68215~(2));Minhe 810800) | | | This paper presentes the theory and design about FIR filter in FPGA.In the article,it designs a 8 stairs lowpass digital filter.Though this example,it discusses some kinds of algorithmic of multiplier in the FIR filter,and contrasted their merits and defects.Then it finds a feasible and efficient method to design the FIR filter.
【Keyword】：VHDL,FPGA,FIR filter, |
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